IBM Research、世界初の2nmチップ技術を発表 [haru★]
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IBM Researchは、2ナノメートル（nm）技術を用いた初のテスト用半導体の製造に成功したと発表した。
これにより、エネルギーフットプリントの削減が可能になるという。
IBMによれば、2nmプロセッサーは7nmノードのチップと比べて性能が45％向上し、電力を75％削減できると想定されている。
このテストチップは、指の爪ほどの大きさのチップに、500億個のトランジスターを搭載可能だ。
IBMによると、2nmプロセッサーは、人工知能（AI）、エッジコンピューティング、自律システムなどの分野で、アプリケーションを加速できる。
同社はこの技術を「IBM Power Systems」や「IBM Z」で利用する可能性があると述べている。
IBM ResearchのディレクターDario Gil氏は、この新しいプロセッサーによって、持続可能性や気候変動の課題に対応できるとしている。
IBMによると、データセンターは世界のエネルギー消費量の1％を占めている。
Khare氏によると、2nm技術は2024年末ごろに生産を開始する可能性がある。
2021-05-07 11:09
https://japan.zdnet.com/article/35170356/
https://japan.zdnet.com/storage/2021/05/07/cd4c93655ebbad558d090d7250841f8a/ibm-research-2-nm-wafer.jpg
https://japan.zdnet.com/storage/2021/05/07/8be1edbf2836bf1f816e6f5ad7b1d127/screen-shot-2021-05-04-at-10-10-28-am.png ついにIBM POWER PCで新MacOS9が？ エッチングはどうすんだ
光の波長から無理じゃなかったか >>9
なんでエッチングに光の波長が関係あるんだよ
露光だろ こうなると、猫や犬や鳥に
盗聴器仕込むのも時間の問題かな？ さすがにそこまでいくと熱密度上がりすぎてまずいんじゃないの
Ryzenも7nmになって消費電力の割に熱い冷えない問題になってるじゃん IBMの時代が帰ってくるのか
このままだと台湾一強だから、アメリカも焦っているだろう 2nmとかになると、量子力学の世界に突入してそうだけど… >>4
写真を見たらわかる通りプロセス世代は12nm
２ｎｍはなんの意味もない数値なんだよ
バズワード >>25
半導体技術は特許の塊だからな
自社で実用化しなくても特許料で食べて行ける >Khare氏によると、2nm技術は2024年末ごろに生産を開始する可能性がある。
量産化ってわけじゃないよね？ IBMは半導体の量産は捨てても先端半導体の開発は捨てていない
TSMC、GF、Samsungに特許を売り込んでいる >>12
昔のMacがIBMの採用してたよ
サーバー向けで生きながらえてたのかは知らんが これスマホに入れればポケモンGoやっても冷え冷えけ？ >>33
公称値が2nm
実際のゲート間隔は12nm 一番細いトコだけの話だろ ※ ※ ※の連続だよ
現実的にゃーいくら微細化してもリーク電流で大して性能アガらずもう頭打ち
光配線とダイヤ基板にしなきゃ未来はねーよ >>1
IBMってまだこの手の技術研究しとったんや ナノシートとかって塗って行くと結晶が成長するのかな >>29
IBM当たり、モトローラハズレじゃなかったの ( ﾟ∀ﾟ)
( ∩ミ ほーら、9nmだよ
| ω |
し ⌒Ｊ >>37
その公称値はどうやってはじき出したんだろう？
2nmをうたう何かがあると思うのだけど、さっぱりわからん 3層つながってね？
現像、エッチング3回やったのでは もう古典物理の限界にぶつかってるだろ
量子コンピュータに切り替えてゆけ 外部ノイズの問題があって動作電圧をあんまり下げられないとか、
技術的な壁がいくつかあったと思うけど、それをクリアしたってこと？ サムスンな5nmみたいに量産化したら7nmに劣るとかないよね 2nmと言いながら解説の画像にはどこにも2nmがない
もうこれ大多数の人には理解できんだろ >>51
位置合わせの精度かとも思ったのだけど
そういうのでもないの？ (´・ω・`)これで更にWatsonが賢くなるの？ すげーな
realme GTが昨日届いたんだがSD888で5nmだったか
早く2nmプロセスのSoC積んだスマホ出してくれ ゲート長12nmで三枚のチャネル表裏で12/6=2nm相当？
詐欺やん 富岳の次のスパコンのCPUは、2nmでTSMCが製造してくれそうだな。 あーワクチンでナノチップを注入されてうんたらかんたらで5Gが〜〜 爆熱ビデオカードに採用すればマイニングで儲かりそう
電気代も75％カットだな でも宇宙線や電磁ノイズを考慮したプロユースは何世代も前の
冗長なチップで十分と聞いたぞ
日本も商売的にはだいじょおうぶ どこが2nmかわからんが
電力が75％削減は凄いな >>76
そんな事は無い
当然2nmで宇宙線対応した方が
省電力で処理能力は上 >>79
中国に対抗して本気になったアメさんヤバイな
投入する金が違う >>64
元はゲート間隔だったのが途中で集積度を表すゲート間隔相当の数値になり、
今ではロードマップの目安を示すただの数値に成り下がった バッテリー4倍は魅力的だな
(実際製品化された時の実測値は2倍程度だと思うけどw)
全個体電池と合わせればスマホは1週間ぐらい待つようになったら本当に嬉しいわ >>62
あるよ
エンジンだって排気量が大きい方が高出力とは限らないのと同じ >>54
amazonの Li-IONバッテリーに似たのがあった
商品ラベルには 9900mAhって書いてるが、これは型式で実容量は 3000mAhです！って潔く説明文に明記しててずっこけたわw >>1
画像の見出し以外に2nmの文字が存在しない件
あ、1を書き忘れたのか >>66
塗る現像は一番手
スピン、東京エレク
スキージ、キャノン、東京応化など >>77
75%削減ってのは、いま現在主流の14-22nmプロセスとの比較ではないよ
基本的には0.25um=250nm、0.18um=180nm比で75%減
景表法の取り締まりは及ばないので鵜呑みは禁物w 半導体の製造プロセスってぶっちゃけて言えば
堆積させる
掘る
の２種類しかない
この２種類を使って一番微細加工しているところが2nmという話 ＞ IBMは、ニューヨーク州、サムスン電子、Intelとの提携の下、半導体設計の改良に取り組んでいる。
製造はサムスン電子
まぁ発表が早いだけでTSMCに抜かれるんだろう >>101
ウェットはね ドライというかRIEは異方性エッチング 最近名前聞いてないなと思ったらこんなことやってたのか まあアメリカが最先端半導体開発から降りるわけないよ
軍事技術なんだし 欧米、特に米のグローバル企業は圧倒的に強い
ただそれだけの事
日本とは比較にならないほど欧米資本はブランド力がある >>108
日本は比較にならんほど資本を出さない。
リスクから全力で逃げ出す。 IBMなんてとうの昔に潰れたのかと
(´・ω・｀) >>98
拡散、インプラはどっちに含まれると言いたいんだ？ スゲエえええと思ったけど、
添付画像のどこにも2nm感がないのはどういうこと…？ >>109
観光立国ですから。学問はカネにならないそうです。
企業も技術者追い出しちゃあ開発なんぞ出来んわね。
技術力よりコミュ力が大事らしいし。観光立国ですから。 そもそも7nmを露光できる露光機も無いんだから、気にしない気にしない 日本はEUV露光機すら1台も持ってないからな
こういうハッタリアピールすらできない >>118
7nmくらいからEUVで複数回露光するマルチパターニングをしてるんじゃないかな >>121
ところが EUV光源は世界で唯一栃木で作ってる、栃木サイコー さらに微細化を進めるには収縮する基盤（ウェハ）を使うしかないなｗ
ドラえもんのスモールライトみたいにウェハごと縮めてしまうｗ >>105
BOSCHプロセスが有名だね
反応性レジスト塗って逆スパッタ（ドライエッチ）とスパッタを繰り返す
よく考えたもんだ >>113
「2nm テクノロジー」って商品名
別に配線の幅が2nmですなんて誰も言ってないし、どこにも書いてない >>122
7nmプロセスってのも配線の幅や太さが7nmって訳じゃないけど エッチング後のチップの線幅じゃなくて露光機のピント性能が2nm レイアウト詰めたり上下に積んだりもろもろの効果を
鉛筆舐めながら織り込んで2nm相当という話なので
デバイス量産せず製品RMもないIBMが言う2nmには
たいした意味ないです。自称最先端。 2nmですか、でもお高いんでしょう？
消費電力が問題にならない環境用としては、10nm前後から不満はなくなってきてますわ >>4 縦積み型が２ナノ、東北大学TSMC連合も発表してる そろそろサムスンが1nmを発表するとか？
※1nmは世代記号で配線幅との関係はありません 微細化は2nmが限界なのだろうか
それとも1nmまでいけるのか？ >>135
ただのブランド名だから、数年後には数百pmプロセスって言ってるだろうよ 最先端の配線はどのくらいのプロセスまで行ってるの？ 例えるなら、12nmの微細な筆を2nm単位の精密さで動かせますみたいな感じ？ >>138
いや違う回路のCMOSレイアウト面積を昔ながらのレイアウト換算で定義したりこざかしいことをやる
同じ最小寸法のレイアウトでも上下につめば半分のノードみたいな
素子間の絶縁に使う部分の寸法を詰めてそれも勘定に入れたり
2nmといってもこの素子の最小寸法はゲートの12nm NC旋盤とマシニングで仕事してるけどnmのチップを製造する部品ってどーやって製造してんねん プロセスルール縮小するたびにビクビク思うんやけど
運用中の故障とかの心配ないんだろうか？ 一気に2nmはゲームチェンジャーだな。まともに量産できればだけど。 そっちはまだナノプロセスかよ
こっちはピコプロセスやで それでもその2nmのフォトマスクは世界シェア九割のHOYA製だし
シリコンウエハはもちろん信越化学工業 今は単なる微細化だけならリーク漏れ過ぎて使い物にならんよ
サムスンの3nmプロセスがどうなるかだな ソフトのバージョン名に西暦を使って毎年買い換え促してたのと同じ感じ。プロセスルール名をバージョンに使って情弱騙してんだよな 日本は佐賀大がスーパーダイアモンド半導体の開発に成功してます。
さっさと実用化してほしいです。 >>147
TSMCは客だぞ IBMの半導体は特許ビジネス屋 >>140
どうやってって言われても機械が決められた動作してるとしか言えない
ただ、機械の精度は桁違いに高いけど
あとアライメントの精度も桁違いに高い ■ このスレッドは過去ログ倉庫に格納されています
